FPGA Xilinx

Formations sur les FPGA Xilinx et la suite Vivado

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Formation
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F_VBASE Conception de FPGA à l'aide de Vivado Design Suite NOUVEAU   4j3200 €
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Description

Pour ceux qui ne sont pas initiés à la conception FPGA, ce cours contribue à la conception d'un design FPGA, qui comprend la création d'un projet Vivado Design Suite avec des fichiers sources, la simulation de la conception, l'exécution d'affectations de broches, l'application de contraintes de timing de base, la synthèse, la mise en œuvre et le débogage de la conception.

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F_STAXDC Analyse statique de timing (STA) Contraintes de Design Xilinx (XDC) et Utilisation Avancée de Vivado NOUVEAU   4j3200 €
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Formation sur les contraintes de timing au format XDC (SDC), l'analyse statique de timing, les bonnes pratiques de conception d'un FPGA Xilinx (UltraFast Design Methodology) et l'utilisation avancée de la suite Vivado™

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F_PR Reconfiguration Partielle NOUVEAU   2j2000 €
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Comprendre comment générer et assembler des partitions reconfigurables afin de pouvoir (re)configurer partiellement et dynamiquement un FPGA Xilinx™

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Prix HT
F_US Conception avec les familles Xilinx™ UltraScale et UltraScale+ NOUVEAU   2j1600 €
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Comprendre l'architecture des FPGAs Xilinx™ Ultrascale et UltraScale+ afin d'utiliser efficacement les ressources

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F_7SERIE Conception avec les familles Xilinx™ Série-7   2j
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Apprendre à utiliser efficacement l’architecture des FPGAs Xilinx™ Serie-7 (Spartan-7, Artix-7, Kintex-7, Virtex-7)

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SoC & MPSoC Xilinx

Formations sur les SoC Zynq-7000® et MPSoC Zynq® UltraScale+™ et les outils de développement

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Formation
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Prix HT
E_ZAHS L'essentiel de la conception embarquée pour les composants Xilinx Zynq™-7000 et Zynq MPSoC NOUVEAU   4j3200 €
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Description

Cette formation s'adresse à ceux qui débute une conception embarqué à base de Zynq™-7000 ou de Zynq UltraScale+™ MPSoC ou même de MicroBlaze™. L'Architecture Système, la Conception Matérielle et Logicielle, ainsi que l'utilisation des outils sont abordés à travers théorie et exercices sur carte ZedBoard ou ZCU104 au choix.

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E_ZADV Zynq-7000™ : Conception Avancée de Systèmes Embarqués NOUVEAU   2j1600 €
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Cette formation adresse les concepts les plus avancées utilisés lors d'une conception matériel d'un SoC à base de Zynq™-7000 (debug AXI, AXI-Streaming, Contrôleurs mémoire, DMA et boot du composant). Cette formation s'adresse à ceux qui ont déja une expérience de l'architecture et de développement matériel et logiciel sur Zynq-7000 et qui souhaitent confirmer et approfondir leurs connaissances.

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Formation
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Prix HT
E_ZUPSA Zynq UltraScale+™ MPSoC : Architecture Système   2j2000 €
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Description

Formation sur l'architecture des composants Zynq UltraScale+™ de Xilinx qui embarque un dual/quad ARM® Cortex™-A53MP et un dual ARM® Cortex™-R5MP.

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E_ZUPSW Zynq UltraScale+™ MPSoC : Conception Matérielle et Logicielle   2j2000 €
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Description

Formation sur la conception matérielle et logicielle des composants Zynq UltraScale+™ de Xilinx qui embarque un dual/quad ARM® Cortex™-A53MP et un dual ARM® Cortex™-R5MP.

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Vivado™ HLx
D_HLS Vivado™ High Level Synthesis   2j1600 €
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Formation sur l'outil de synthèse C to RTL Xilinx™

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PetaLinux™
E_PLNX Conception Logicielle de systèmes embarqués avec l'outil Xilinx™ Petalinux   2j2000 €
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Formation sur la distribution linux embarqué de Xilinx™ (Petalinux)

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Vitis Xilinx

Formations sur la Plate-forme logicielle unifiée de Vitis

Référence
Formation
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Prix HT
E_VITIS Atelier pour migrer vers l'IDE de développement de logiciels embarqués de Vitis NOUVEAU   1j800 €
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Description

Cet atelier présente les outils et les techniques nécessaires à la conception et au développement de logiciels à l'aide de la plate-forme logicielle unifiée Vitis™. L'accent est mis sur ce cours : Révision des bases de l'utilisation de la plate-forme Vitis Migration des projets SDK existants vers la plateforme Vitis Développer des applications logicielles en utilisant la plate-forme Vitis

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Formation
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Prix HT
AI_ACCEL Accélération des applications avec l'environnement logiciel unifié Vitis NOUVEAU   2j2000 €
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Ce cours apprend à développer, déboguer et profiler des applications C/C++ et RTL nouvelles ou existantes dans l'environnement logiciel unifié Vitis™ ciblant à la fois les centres de données (DC) et les applications embarquées. Apprenez également à exécuter des conceptions sur la carte accélératrice Xilinx Alveo™ en utilisant Nimbix Cloud.

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Connectivité

Formations sur la connectivité des FPGA

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Prix HT
C_TRX Conception avec les Transceivers séries Xilinx NOUVEAU   2j1600 €
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Description

Dans ce cours de deux jours, vous apprendrez à utiliser des transceivers série dans votre série 7, UltraScale ™, UltraScale + ™ FPGA ou Zynq® UltraScale + MPSoC. Vous identifiez et utilisez les caractéristiques des blocs d'émetteurs-récepteurs série, tels que l'encodage 8B / 10B et 64B / 66B, le chnnel bonding, la correction de l'horloge et la détection des comma.

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Formation
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Prix HT
C_PCIE Conception d'un système Logicore PCI-Express   2j 
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Description

Cette formation explique la mise en œuvre matérielle du core PCI-e de Xilinx™

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Sur demande
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Formation
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Prix HT
003368A Le bus Ethernet NOUVEAU   2j 
Détail
Description

Toute la vulgarisation nécessaire à la compréhension d'un réseau Ethernet

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Sur demande
003367A Ethernet & Switching   4j 
Détail
Description

analyse de la spécification Ethernet avec le modèle OSI comme fil rouge

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Sur demande

Traitement du Signal sur FPGA

Formations sur le développement d'application de type Traitement Numérique du Signal

Référence
Formation
Durée
Prix HT
D_ESS Techniques d’Implémentation de fonctions DSP pour FPGA Xilinx™   2j1600 €
Détail
Description

Cette formation permet de bien comprendre les ressources des FPGAs Xilinx™ pour l’implémentation des algorithmes de traitement numérique du signal.

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Langages HDL

Formations sur les langages de description matérielle

Référence
Formation
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Prix HT
L_VHDL Synthèse logique et simulation VHDL pour Conception de FPGA Xilinx™ NOUVEAU   5j2500 €
Détail
Description

Formation sur l'architecture générale des FPGAs Xilinx, le langage VHDL pour la synthèse et la simulation d'un FPGA Xilinx et les méthodologies de base (asynchronisme, IP Catalog, contraintes basiques - timing, IOs -, analyse statique de timing)

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Formation
Durée
Prix HT
L_VV_UP Mise à jour VHDL vers Verilog et Verilog vers VHDL NOUVEAU   2j1600 €
Détail
Description

Cette formation s'adresse à ceux qui maîtrisent l'un des deux langages de synthèse RTL (VHDL ou Verilog) et qui souhaitent comprendre et/ou utiliser l'autre langage (VHDL ou Verilog) dans leurs développements.

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